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模擬設(shè)計(jì)工程師 35-55萬: 武漢半導(dǎo)體高速發(fā)展公司; 所屬部門：研發(fā)部 匯報(bào)對(duì)象：創(chuàng)始人; 碩士以上語言能力不限年齡要求:不限工作年限:不限性別不限; 投遞簡(jiǎn)歷
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模擬設(shè)計(jì)工程師35-55萬: 武漢半導(dǎo)體高速發(fā)展公司; 所屬部門：研發(fā)部 匯報(bào)對(duì)象：創(chuàng)始人; 碩士以上語言能力不限年齡要求:不限工作年限:不限性別不限; 投遞簡(jiǎn)歷
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職位描述: 崗位職責(zé)：
1. 負(fù)責(zé) SoC 芯片中模擬 IP 的設(shè)計(jì)和驗(yàn)證，含各類不同性能的 PLL、各類高速接口，時(shí)鐘定制電路等模擬 IP；
2. 根據(jù) SoC 芯片的項(xiàng)目進(jìn)度，按時(shí)完成電路設(shè)計(jì)、仿真和版圖設(shè)計(jì)，并提交 SoC 設(shè)計(jì)需要的數(shù)據(jù)；
3. 協(xié)助完成模擬 IP 在 SoC 芯片中的集成、驗(yàn)證和后端設(shè)計(jì)；
4. 完成 SoC 樣片驗(yàn)證中模擬 IP 相關(guān)的性能和指標(biāo)測(cè)試。
任職要求：
1. 電子、微電子相關(guān)專業(yè)，碩士及以上學(xué)歷；
2. 具有模擬電路設(shè)計(jì)經(jīng)驗(yàn)，深入掌握模擬集成電路設(shè)計(jì)流程；
3. 具有扎實(shí)的模擬或數(shù)模混合電路的基本知識(shí)，熟練掌握 SERDES、PLL/DLL、ADC/DAC 等領(lǐng)域的相關(guān)設(shè)計(jì)；
4. 深入了解半導(dǎo)體器件和工藝，熟悉先進(jìn)工藝制程；
5. 熟悉 Custom Compiler / Virtuoso, hspice, spectre, Hercules, ICV, Calibre, StarRCXT 等 EDA 工具；
6. 具有良好的學(xué)習(xí)，分析和創(chuàng)新能力以及團(tuán)隊(duì)合作精神；
7. 能熟練閱讀英文資料并能用英文撰寫技術(shù)規(guī)范，設(shè)計(jì)和測(cè)試報(bào)告
企業(yè)介紹
工作地址: 上海

職位發(fā)布者